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HD6432147SW Datasheet(PDF) 124 Page - Renesas Technology Corp |
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HD6432147SW Datasheet(HTML) 124 Page - Renesas Technology Corp |
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124 / 1140 page ![]() 3. MCU 動作モード 91 3.2.4 シリアルタイマコントロールレジスタ(STCR) 7 IICS 0 R/W 6 IICX1 0 R/W 5 IICX0 0 R/W 4 IICE 0 R/W 3 FLSHE 0 R/W 0 ICKS0 0 R/W 2 − 0 R/W 1 ICKS1 0 R/W ビット 初期値 R/W : : : STCR は 8 ビットのリー ド/ライト可能なレジスタで、レジスタ アクセスの制御、IIC の動作モードの制御(IIC 内蔵オプションの場合)、内蔵フラッシュメモリの制御(F-ZTAT 版の場合)、TCNT の入力クロックの選択を行います。レジスタアクセスの制御以外の詳 細は、各モジュールの説明を参照してください。STCR で制御するモジュールを使用しな い場合は、当該ビットに 1 をライトしないでください。 STCR はリセットまたはハードウェアスタ ンバイモード時に H'00 にイニシャライズさ れます。 ビット 7∼5:I 2C コントロール(IICS、IICX1、IICX0) ポート A のバスバッファ機能および IIC 内蔵オプションの場合、I 2C バスインタフェー スの動作を制御するビットです。詳しくは 「16.2.7 シリアルタイマコントロールレジス タ(STCR)」を参照してください。 ビット 4:I 2 C マスタイネーブル(IICE) I 2C バスインタフェースのデータレジスタと制御レジスタ(ICCR、ICSR、ICDR/SARX、 ICMR/SAR ) 、PWMX のデー タレ ジスタ と制御 レジ スタ( DADRAH/DACR、 DADRAL、 DADRBH/DACNTH 、DADRBL/DACNTL)、SCI の制御レジスタ(SMR、BRR、SCMR)の CPU アクセスを制御します。 |
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