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HD6432147SW Datasheet(PDF) 243 Page - Renesas Technology Corp |
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HD6432147SW Datasheet(HTML) 243 Page - Renesas Technology Corp |
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243 / 1140 page  7. データトランスファコントローラ（DTC） 210 7.3.8 チェイン転送 CHNE ビットを 1 にセットしておくことにより、1 回の転送要求に対し複数のデータ転 送を連続して行うことができます。データ転送を定義する SAR、DAR、CRA、CRB およ び MRA、MRB は各々独立に設定できます。 図 7.9 にチェイン転送のメモリマップを示します。 レジスタ情報 先頭アドレス レジスタ情報 CHNE＝1 DTCベクタ アドレス レジスタ情報 CHNE＝0 ソース デスティネーション ソース デスティネーション 図 7.9 チェイン転送のメモリマップ CHNE ＝1 の転 送において、指定 した転送回数の終了 による CPU への割込 み要求や、 DISEL ＝1 による CPU への割込み要求は発生しません。また、CHNE＝1 の転送は起動要 因となった割込み要因フラグに影響を与えません。 |
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