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HD6432147SW Datasheet(PDF) 261 Page - Renesas Technology Corp |
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HD6432147SW Datasheet(HTML) 261 Page - Renesas Technology Corp |
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261 / 1140 page  8. I/O ポート 228 8.2.2 レジスタ構成 表 8.4 にポート 1 のレジスタ構成を示します。 表 8.4 ポート 1 レジスタ構成 名 称 略称 R/W 初期値 アドレス* 1 ポート 1 データ ディレクションレジスタ P1DDR W H'00 H'FFB0 ポート 1 データレジスタ P1DR R/W H'00 H'FFB2 ポート 1 プルアップ MOS コントロールレジスタ P1PCR R/W H'00 H'FFAC 【注】 *1 アドレスの下位 16 ビットを示しています。 （1）ポート 1 データディレクションレジスタ（P1DDR） 7 P17DDR 0 W 6 P16DDR 0 W 5 P15DDR 0 W 4 P14DDR 0 W 3 P13DDR 0 W 0 P10DDR 0 W 2 P12DDR 0 W 1 P11DDR 0 W ビット 初期値 R/W ： ： ： P1DDR は、8 ビットのライト専用レジスタで、ポート 1 の各端子の入出力をビットごと に指定します。リードは無効です。リードすると不定値が読み出されます。 P1DDR は、リセットまたはハードウェアスタンバイモードでは、H'00 に初期化されま す。ソフトウェアスタンバイモードでは 、P1DDR は直前の状態を保持します。ソフトウ ェアスタンバイモードに遷移したとき、アドレス出力端子は出力状態を保持します。 （a）モード 1 P1DDR の設定値にかかわらず、対応するポート 1 の各端子はアドレス出力となります。 ハードウェアスタンバイモード時は、アドレス出力はハイインピーダンス状態となりま す。 |
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