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HD6432147SW Datasheet(PDF) 283 Page - Renesas Technology Corp |
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HD6432147SW Datasheet(HTML) 283 Page - Renesas Technology Corp |
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283 / 1140 page  8. I/O ポート 250 8.6.3 端子機能 ポート 5 の各端子は、SCI0 の入出力端子（TxD0、RxD0、SCK0）、 IIC0 の入出力端子 （SCL0）と兼用になっています。ポート 5 の端子機能を 表 8.13 に示します。 表 8.13 ポート 5 の端子機能 端子 選択方法と端子機能 P52/SCK0 /SCL0 SCI0 の SMR の C/A ビット、SCR の CKE0、CKE1 ビット、IIC0 の ICCR の ICE ビット、および P52DDR ビットの組み合わせにより、次のように切り替わります。 ICE CKE1 C/ A CKE0 P52DDR 端子機能 0 01 − − SCK0 出力端子 1 − − − SCK0 入力端子 0 1 − SCK0 出力端子 1 P52 出力端子 0 P52 入力端子 0 1 0 0 0 − SCL0 入出力端子 SCL0 入出力端子として使用する場合は、SCI0 の SCR の CKE1、 CKE0 ビット、SMR の C/A ビットの各ビットを必ず 0 にクリアしてください。なお、SCL0 の出力形式 は、NMOS オープンドレイン出力となり、直接バス駆動が可能です。 また、H8S/2148 シリーズ、H8S/2147N では、P52 出力端子、SCK0 出力端子に設 定した場合の出力形式は、NMOS プッシュプル出力となります。 P51/RxD0 SCI0 の SCR の RE ビットと P51DDR ビットの組み合わせにより、次のように切 り替わります。 RE P51DDR 端子機能 0 P51 入力端子 1 − RxD0 入力端子 0 1 P51 出力端子 P50/TxD0 SCI0 の SCR の TE ビットと P50DDR ビットの組み合わせにより、次のように切り 替わります。 TE P50DDR 端子機能 0 P50 入力端子 1 − TxD0 出力端子 0 1 P50 出力端子 |
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