HD64F2144A datasheet(9/1140 Pages) RENESAS

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変更内容（詳細はマニュアル参照）

割込みコントローラ 5.1.1

特長

121

ICR

により、優先順位を設定可能部分の説明

修正

5.1.2

ブロック図

122

図 5.1 割込みコントローラのブロック図で

内部割込み要因修正

5.1.4

レジスタ構成

123

表 5.2 割込みコントローラのレジスタ構成

修正

5.2.2

インタラプトコントロール

レジスタ A∼C（ICRA∼ICRC）

125

説明修正

5.2.5

IRQ

ステータスレジスタ（ISR） 128

ビット 7∼0 の注追加

5.2.6

キーボードマトリクス割込み

レジスタ（KMIMR）

130

説明修正と注修正

5.2.7

キーボードマトリクス割込み

マスクレジスタ（KMIMRA）

131

ビット 7∼0 の説明修正

5.3.1

外部割込み

135

（2）IRQ7∼IRQ0 割込み説明追加「IRQ6

端子を……0 にクリアしてください」

5.3.2

内部割込み

136

説明修正 PC ブレークをアドレスブレーク

に修正

5.3.3

割込み例外処理ベクタテーブル

137

表 5.4 割込み要因とベクタアドレスおよび

割込み優先順位一覧（1）PC ブレークをアド

レスブレーク（PC ブレーク）に修正

5.5.1

割込み制御モードと割込み動作

142

説明修正

143

表 5.6 割込み制御モードと選択される割込

み修正

5.5.2

割込み制御モード 0

145

（3）説明修正

5.5.3

割込み制御モード 1

147

説明修正と図 5.9 割込み制御モード 1 の状態

遷移例修正

バスコントローラ

6.2.2

ウェイトステートコントロール

レジスタ（WSCR）

164

ビット 7 説明追加

6.3.4

I/O

セレクト信号

168

表 6.4 IOS 信号出力範囲の設定注追加

データトランスファ

コントローラ（DTC）

7.3.3

DTC

ベクタテーブル

205

表 7.4 割込み要因と DTC ベクタアドレスお

よび対応する DTCE 修正

I/O ポート

8.1

概要

220

表 8.1 H8S/2148 シリーズポートの機能一覧

ポート 2 の拡張モード 2、3 説明修正

223

表 8.2 H8S/2147N ポートの機能一覧ポー

ト 2 の拡張モード 2、3 説明修正

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