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HD6432147SW Datasheet(PDF) 155 Page - Renesas Technology Corp |
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HD6432147SW Datasheet(HTML) 155 Page - Renesas Technology Corp |
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155 / 1140 page  5. 割込みコントローラ 122 5.1.2 ブロック図 割込みコントローラのブロック図を 図 5.1 に示します。 ：IRQセンスコントロールレジスタ ：IRQイネーブルレジスタ ：IRQステータスレジスタ ：インタラプトコントロールレジスタ ：システムコントロールレジスタ SYSCR NMI 入力 IRQ 入力 内部割込み要因 SWDTEND ∼ PS2IC INTM1 INTM0 NMIEG NMI 入力部 IRQ 入力部 ISR ISCR IER ICR 割込みコントローラ 優先順位 判定 割込み要求 ベクタ番号 I 、UI CCR CPU ISCR IER ISR ICR SYSCR 【 記号説明 】 図 5.1 割込みコントローラのブロック図 5.1.3 端子構成 割込みコントローラの端子構成を 表 5.1 に示します。 表 5.1 端子構成 名 称 記号 入出力 機 能 ノンマスカブル 割込み NMI 入力 マスク不可能な外部割込み。 立ち上がりエッジまたは立ち下がりエッジを選択可能 外部割込み要求 7 ∼0 IRQ7 ∼ IRQ0 入力 マスク可能な外部割込み。 立ち下がりエッジ、立ち上がりエッジ、両エッジ、 レベルセンスのいずれかを選択可能 キー入力割込み 要求 15∼0 KIN15 ∼KIN0 入力 マスク可能な外部割込み。 立ち下がりエッジ、レベルセンスのいずれかを選択可能 |
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