M68HC08 datasheet(22/332 Pages) FREESCALE

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Technical Data

MC68HC908JB16 — Rev. 1.1

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Freescale Semiconductor

Figure

Title

Page

8-5

Internal Reset Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

8-6

Sources of Internal Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

8-7

POR Recovery . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 104

8-8

Interrupt Processing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109

8-9

Interrupt Entry . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110

8-10

Interrupt Recovery . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110

8-11

Interrupt Recognition Example . . . . . . . . . . . . . . . . . . . . . . . . 111

8-12

Interrupt Status Register 1 (INT1). . . . . . . . . . . . . . . . . . . . . . 112

8-13

Interrupt Status Register 2 (INT2). . . . . . . . . . . . . . . . . . . . . . 114

8-14

Wait Mode Entry Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 116

8-15

Wait Recovery from Interrupt or Break . . . . . . . . . . . . . . . . . . 116

8-16

Wait Recovery from Internal Reset. . . . . . . . . . . . . . . . . . . . . 116

8-17

Stop Mode Entry Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 117

8-18

Stop Mode Recovery from Interrupt or Break . . . . . . . . . . . . . 117

8-19

SIM Break Status Register (SBSR) . . . . . . . . . . . . . . . . . . . . 118

8-20

SIM Reset Status Register (SRSR) . . . . . . . . . . . . . . . . . . . . 119

8-21

SIM Break Flag Control Register (SBFCR) . . . . . . . . . . . . . . 120

9-1

Monitor Mode Circuit. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 125

9-2

Low-Voltage Monitor Mode Entry Flowchart. . . . . . . . . . . . . . 127

9-3

Monitor Data Format. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 129

9-4

Break Transaction. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 129

9-5

Read Transaction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130

9-6

Write Transaction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 131

9-7

Stack Pointer at Monitor Mode Entry . . . . . . . . . . . . . . . . . . . 134

9-8

Monitor Mode Entry Timing. . . . . . . . . . . . . . . . . . . . . . . . . . . 135

10-1

TIM Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 140

10-2

TIM I/O Register Summary . . . . . . . . . . . . . . . . . . . . . . . . . . . 141

10-3

PWM Period and Pulse Width . . . . . . . . . . . . . . . . . . . . . . . . 146

10-4

TIM Status and Control Register (TSC) . . . . . . . . . . . . . . . . . 152

10-5

TIM Counter Registers High (TCNTH) . . . . . . . . . . . . . . . . . . 154

10-6

TIM Counter Registers Low (TCNTL) . . . . . . . . . . . . . . . . . . . 155

10-7

TIM Counter Modulo Register High (TMODH) . . . . . . . . . . . . 155

10-8

TIM Counter Modulo Register Low (TMODL) . . . . . . . . . . . . . 155

10-9

TIM Channel 0 Status and Control Register (TSC0) . . . . . . . 156

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