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TMS320VC5501 Datasheet(PDF) 12 Page - Texas Instruments

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Part # TMS320VC5501
Description  TMS320VC5501 Fixed-Point Digital Signal Processor
PDF  193 Pages
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Manufacturer  TI [Texas Instruments]
Direct Link  http://www.ti.com
Logo TI - Texas Instruments

TMS320VC5501 Datasheet(HTML) 12 Page - Texas Instruments

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background image
Tables
12
December 2002 − Revised November 2004
SPRS206H
Table
Page
3−42
Parallel GPIO Enable Register 2 Bit Field Description
99
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−43
Parallel GPIO Direction Register 2 Bit Field Description
99
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−44
Parallel GPIO Data Register 2 Bit Field Description
100
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−45
Pins With Pullups, Pulldowns, and Bus Holders
101
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−46
External Bus Control Register Bit Field Description
102
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−47
I/O Addresses Under Scope of XPORT
103
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−48
XPORT Configuration Register Bit Field Description
104
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−49
XPORT Bus Error Register Bit Field Description
105
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−50
DPORT Configuration Register Bit Field Description
106
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−51
DPORT Bus Error Register Bit Field Description
107
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−52
IPORT Bus Error Register Bit Field Description
108
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−53
System Configuration Register Bit Field Description
109
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−54
Time-Out Control Register Bit Field Description
110
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−55
CPU Memory-Mapped Registers
111
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−56
Peripheral Bus Controller Configuration Registers
113
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−57
External Memory Interface Registers
114
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−58
DMA Configuration Registers
115
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−59
Instruction Cache Registers
118
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−60
Trace FIFO
118
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−61
Timer Signal Selection Register
118
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−62
Timers
118
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−63
Multichannel Serial Port #0
120
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−64
Multichannel Serial Port #1
121
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−65
HPI
122
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−66
GPIO
122
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−67
Device Revision ID
123
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−68
I2C
123
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−69
UART
124
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−70
External Bus Selection
124
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−71
Clock Mode Register
124
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−72
CLKOUT Selector Register
124
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−73
Clock Controller Registers
125
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−74
IDLE Control Registers
125
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−75
Interrupt Table
126
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5−1
Recommended Crystal Parameters
137
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5−2
CLKIN in Bypass Mode Timing Requirements
139
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5−3
CLKOUT in Bypass Mode Switching Characteristics
139
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5−4
CLKIN in Lock Mode Timing Requirements
140
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5−5
CLKOUT in Lock Mode Switching Characteristics
140
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5−6
EMIF Timing Requirements for ECLKIN
142
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5−7
EMIF Switching Characteristics for ECLKOUT1
142
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5−8
EMIF Switching Characteristics for ECLKOUT2
143
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5−9
Asynchronous Memory Cycle Timing Requirements for ECLKIN
144
. . . . . . . . . . . . . . . . . . . . . . . . . . .
5−10
Asynchronous Memory Cycle Switching Characteristics for ECLKOUT1
144
. . . . . . . . . . . . . . . . . . . . .
5−11
Programmable Synchronous Interface Timing Requirements
147
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5−12
Programmable Synchronous Interface Switching Characteristics
147
. . . . . . . . . . . . . . . . . . . . . . . . . . .



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