UPSD3422_V01 datasheet(8/300 Pages) STMICROELECTRONICS

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Contents

UPSD3422, UPSD3433, UPSD3434, UPSD3454

8/300

28.1

PSD module functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . 192

28.1.1

8032 address/data/control interface . . . . . . . . . . . . . . . . . . . . . . . . . . . 192

28.1.2

Dual Flash memories and IAP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 192

28.1.3

Main Flash memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 192

28.1.4

Secondary Flash memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 193

28.1.5

SRAM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 193

28.1.6

Runtime control registers, csiop . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 193

28.1.7

Memory page register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 193

28.1.8

Programmable logic (PLDs) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 194

28.1.9

PLD #1, decode PLD (DPLD) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 194

28.1.10 PLD #2, general PLD (GPLD) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 194

28.1.11 OMCs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195

28.1.12 OMC allocator . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195

28.1.13 IMCs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195

28.1.14 I/O ports . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 195

28.1.15 JTAG port . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 196

28.1.16 Power management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 197

28.1.17 Security and NVM sector protection . . . . . . . . . . . . . . . . . . . . . . . . . . 197

28.2

Memory mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 197

28.2.1

8032 program address space . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 198

28.2.2

8032 data address space (XDATA) . . . . . . . . . . . . . . . . . . . . . . . . . . . 198

28.2.3

Specifying the memory map with PSDsoft express . . . . . . . . . . . . . . . 198

28.2.4

EEPROM emulation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 199

28.2.5

Alternative mapping schemes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 200

28.2.6

Memory sector select rules . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 202

28.2.7

The VM register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 203

28.3

PSD module data bus width . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 204

28.4

Runtime control register definitions (csiop) . . . . . . . . . . . . . . . . . . . . . . 205

28.5

PSD module detailed operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 207

28.5.1

Flash memory operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 207

28.5.2

Flash memory instruction sequences . . . . . . . . . . . . . . . . . . . . . . . . . 208

28.5.3

Reading Flash memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 210

28.5.4

Read memory contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 210

28.5.5

Reading the erase/program status bits . . . . . . . . . . . . . . . . . . . . . . . . 210

28.5.6

Data polling flag (DQ7) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 210

28.5.7

Toggle flag (DQ6) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 211

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