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TMS320C54CST Datasheet(PDF) 8 Page - Texas Instruments

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Part # TMS320C54CST
Description  Client Side Telephony DSP
PDF  171 Pages
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Manufacturer  TI [Texas Instruments]
Direct Link  http://www.ti.com
Logo TI - Texas Instruments

TMS320C54CST Datasheet(HTML) 8 Page - Texas Instruments

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background image
Figures
8
November 2001 − Revised September 2003
SPRS187B
List of Figures
Figure
Page
2−1
144-Ball GGU MicroStar BGA (Bottom View)
17
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2−2
144-Pin PGE Low-Profile Quad Flatpack (Top View)
19
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2−3
Si3016 Pin Assignments
20
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−1
TMS320C54CST Functional Block Diagram
26
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−2
Program and Data Memory Map
29
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−3
Extended Program Memory Map
30
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−4
Processor Mode Status (PMST) Register
31
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−5
Software Wait-State Register (SWWSR) [Memory-Mapped Register (MMR) Address 0028h]
32
. . .
3−6
Software Wait-State Control Register (SWCR) [MMR Address 002Bh]
33
. . . . . . . . . . . . . . . . . . . . . . .
3−7
Bank-Switching Control Register (BSCR) [MMR Address 0029h]
34
. . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−8
Host-Port Interface — Nonmultiplexed Mode
37
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−9
HPI Memory Map
38
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−10
Multichannel Control Register (MCR1)
40
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−11
Multichannel Control Register (MCR2)
40
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−12
Pin Control Register (PCR)
41
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−13
Nonconsecutive Memory Read and I/O Read Bus Sequence
43
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−14
Consecutive Memory Read Bus Sequence (n = 3 reads)
44
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−15
Memory Write and I/O Write Bus Sequence
45
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−16
DMA Transfer Mode Control Register (DMMCRn)
46
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−17
On-Chip DMA Memory Map for Program Space (DLAXS = 0 and SLAXS = 0)
48
. . . . . . . . . . . . . . . .
3−18
On-Chip DMA Memory Map for Data and IO Space (DLAXS = 0 and SLAXS = 0)
49
. . . . . . . . . . . . .
3−19
DMPREC Register
50
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−20
UART Functional Block Diagram
53
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−21
General-Purpose I/O Control Register (GPIOCR) [MMR Address 003Ch]
63
. . . . . . . . . . . . . . . . . . . .
3−22
General-Purpose I/O Status Register (GPIOSR) [MMR Address 003Dh]
64
. . . . . . . . . . . . . . . . . . . . .
3−23
Device ID Register (CSIDR) [MMR Address 003Eh]
64
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−24
Functional Block Diagram
71
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−25
Register 1 − Control 1 Register Layout
73
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−26
Register 2 − Control 2 Register Layout
74
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−27
Register 3 − Reserved Register Layout
75
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−28
Register 4 − Reserved Register Layout
75
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−29
Register 5 − DAA Control 1 Register Layout
76
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−30
Register 6 − DAA Control 2 Register Layout
77
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−31
Register 7 − Reserved Register Layout
78
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−32
Register 8 Layout (Reserved)
78
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−33
Register 9 − Sample Rate Control Register Layout
79
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−34
Register 10 − Reserved Register Layout
79
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−35
Register 11 − Chip A Revision Register Layout
80
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−36
Register 12 − Line-Side Status Register Layout
81
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .



Html Pages

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